Intel continuerà a infrangere la legge di Moore fino al 2025

Nella tua incessante ricerca della legge di Moore, Intel sta sbloccando importanti progressi nel packaging, nei transistor e nella fisica quantistica che sono fondamentali per far avanzare e accelerare l’informatica anche nel prossimo decennio.

All’IEEE International Electron Devices Meeting (IEDM) 2021, Intel ha presentato il suo percorso per un miglioramento della densità di interconnessione di oltre 10 volte nell’imballaggio con giunzione ibrida, un miglioramento dell’area superficiale del 30-50% nel ridimensionamento dei transistor, importanti progressi nelle nuove tecnologie di alimentazione e memoria e nuovi concetti di fisica che un giorno potrebbero rivoluzionare l’informatica.

“In Intel, la ricerca e l’innovazione necessarie per far progredire la Legge di Moore non si fermano mai. Il nostro Component Research Group condivide i principali progressi della ricerca in occasione dell’IEDM 2021 per portare tecnologie di imballaggio e processo innovative per soddisfare l’insaziabile domanda di elaborazione potente su cui la nostra industria e la nostra società dipendono. Questo è il risultato del lavoro instancabile dei nostri migliori scienziati e ingegneri. Continuano ad essere in prima linea nelle innovazioni per continuare la Legge di Moore “, ha affermato Robert Chau, Senior Fellow Intel e CEO di Component Research

  • I ricercatori dell’azienda hanno delineato soluzioni alle sfide di progettazione, processo e assemblaggio dell’interconnessione ibrida, prevedendo un miglioramento di oltre 10 volte nella densità di interconnessione nell’imballaggio. In occasione dell’evento Intel Accelerated di luglio, Intel ha annunciato l’intenzione di introdurre Foveros Direct, che consente picchi di urto inferiori a 10 micron, un aumento di un ordine di grandezza nella densità di interconnessione per lo stacking 3D. Affinché l’ecosistema possa beneficiare dei vantaggi del packaging avanzato, Intel chiede anche che vengano stabiliti nuovi standard di settore e procedure di test per consentire un ecosistema di chiplet a giunzione ibrida.

  • Guardando oltre la sua porta RibbonFET, Intel sta dominando la prossima era post-FinFET con un approccio multi-transistor stacking (CMOS) che mira a ottenere un miglioramento massimizzato dal 30% al 50% nel ridimensionamento logico per l’avanzamento. transistor per millimetro quadrato.
  • Intel sta anche aprendo la strada al progresso della Legge di Moore nell’era angstrom con ricerche orientate al futuro che mostrano come nuovi materiali dello spessore di pochi atomi possono essere utilizzati per realizzare transistor che superano i limiti del canale. per area di matrice da aumentare di milioni per un calcolo sempre più potente nel prossimo decennio.
  • Le tecnologie di alimentazione più efficienti avanzano grazie alla prima integrazione al mondo di interruttori di alimentazione basati su GaN con CMOS a base di silicio su un wafer da 300 mm. Ciò pone le basi per un’alimentazione ad alta velocità e bassa perdita per le CPU, riducendo al contempo i componenti e l’ingombro della scheda madre.
  • Un altro progresso è la capacità di lettura/scrittura a bassa latenza leader del settore di Intel, che utilizza nuovi materiali ferroelettrici per la possibile tecnologia DRAM incorporata di prossima generazione in grado di fornire risorse di memoria più elevate per far fronte alla crescente complessità delle applicazioni. AI.
  • Allo IEDM 2021, Intel ha dimostrato la prima realizzazione sperimentale al mondo di un dispositivo logico magnetoelettrico spin-orbita (MESO) a temperatura ambiente, che ha mostrato la possibilità di produrre un nuovo tipo di transistor basato su magneti di commutazione su scala nanometrica.
  • Intel e IMEC stanno portando avanti la ricerca sui materiali spintronici per avvicinare la ricerca sull’integrazione dei dispositivi alla realizzazione di un dispositivo spin-orbita completamente funzionante.
  • IEL ha anche mostrato i flussi di processo qubit da 300 mm per realizzare il calcolo quantistico scalabile che supporta la fabbricazione CMOS e identifica i prossimi passi per la ricerca futura.

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